2種類のコアで「省電力」と「高パフォーマンス」を両立――Intelが「Alder Lake」の概要を公開 「Sapphire Rapids」にも新情報（3/3 ページ）
» 2021年08月19日 23時30分 公開
[井上翔，ITmedia]
タイル設計でスケーラビリティーを高めたSapphire Rapids
既に「次世代Xeonスケーラブルプロセッサ」として情報の小出しが行われているSapphire Rapidsについても、プロセッサの構造に関する情報が明らかとなった。
Sapphire Rapidsは、先述のハイパフォーマンスコアを主体とするCPUだ。設計自体はAlder Lakeと同じ考え方で、用途に合わせて必要なタイルを組み合わせるようになった。これにより、従来のXeonプロセッサよりもスケーラビリティーが高まっている。
以前の記事でも触れた通り、Sapphire RapidsにはHBM（広帯域メモリ）を備えるモデル（SKU）が登場する予定となっている。
Alder Lakeと同様に、Sapphire RapidsもDDR5メモリをサポートしているが、HBMへのアクセス帯域幅は8チャネル構成のDDR5メモリと比べて「とても広い」。用途によってはDDRメモリが“不要”になる可能性もあるという。
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